Colección de Problemas de Sistemas Secuenciales

3er Curso de Ingeniería Industrial
ELECTRÓNICA DIGITAL I (04/05)
SISTEMAS SECUENCIALES
PROBLEMA 1.
Diseñar un contador módulo 8. El circuito debe diseñarse como autómata de Moore.
PROBLEMA 2.
Diseñar completamente un contador de 3 bits con 2 entradas A/D y M tal que:
A/D =1 cuenta ascendente.
M=0 cuenta de uno en uno.
A/D=0 cuenta descendente.
M=1 cuenta de dos en dos.
A/D
M
clk
3
B2 B1 B0
PROBLEMA (cuestión) 3.
Dibujar la forma de Q y /Q en el circuito de la figura. Considerar despreciables los retardos de
propagación.
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ELECTRÓNICA DIGITAL I (04/05)
PROBLEMA 4.
En un sistema digital se transmite información serie (se supone que el primer bit en transmitirse es
el más significativo) en el código BCD natural, en sincronismo con una señal de reloj, y se desea diseñar
un circuito secuencial síncrono que detecte si la palabra recibida pertenece o no al código.
El circuito debe disponer de dos salidas.
- La primera indica fin de detección: se activa en el momento en que se sabe con seguridad si
la palabra pertenece o no al código.
- La segunda salida se activa cuando la palabra no pertenezca al código.
Se debe realizar el diseño del circuito describiendo todos los pasos del diseño de un circuito
secuencial síncrono, empleando la codificación one-hot (uno activo) y biestables J-K como elementos de
memoria.
PROBLEMA 5.
1.- Diseñar un contador síncrono de 3 bits que funcione de la forma siguiente:
Dispone de 2 señales de control: ENABLE y MODE
Si ENABLE=1 el contador funciona según la señal MODE
Si ENABLE=0 el contador para el contaje y se pone la salida a valor 0.
Si MODE=0 es un contador según: 1,3,7,6,4,1,....
Si MODE=1 es un contador según: 1,4,6,7,3,1,....
MODE
ENABLE
B0
B1
B2
CLK
PROBLEMA 6.
Se dispone de una señal periódica C de período T y ancho de pulso T/10. Diseñar un circuito
secuencial síncrono que a partir de dicha señal y en sincronismo con sus flancos de subida, genere otra
señal periódica S cuyo periodo y ancho de banda deban ser seleccionables mediante dos señales de
control C1C0 de tal forma que:
C1 C0
0
0
1
1
0
1
0
1
S
Ancho de pulso
Periodo
No se genera Pulso
T
2T
2T
3T
3T1
4T
PROBLEMA 7.
Implementar un circuito secuencial síncrono con dos entradas (X1X0) y una salida Z. Si
X1X0=“00”, Z=“0”. Para hacer Z=“1” ha de producirse primero el cambio de X0: “0”  “1” y,
manteniéndose X0=”1”, que cambie X1: “0” “1”. Z se vuelve a hacer Z=“0” cuando X1X0=“00”, sin
importar el orden en el que se produzcan los cambios.
PROBLEMA 8.
Diseñe totalmente un circuito con dos entradas, X e Y, que dé salida Z=1 cuando en los cuatro
últimos ciclos de reloj, las entradas hayan sido 11, 01, 01, 11. El circuito debe ser implementado
mediante un esquema de Mealy y utilizando biestables tipo D.
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PROBLEMA (cuestión) 9.
Analice el circuito de la figura y muestre la secuencia de salida para la secuencia de entrada dada.
Nota: El componente con la indicación “=1” corresponde a una puerta XOR
PROBLEMA 10.
Dado el circuito secuencial síncrono de la figura, obtener su tabla de estados siguientes y de salida
y realizar una implementación simplificada del mismo.
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PROBLEMA 11.
T
Diseñar un circuito secuencial de Mealy
que compare dos valores de 3 bits, X e Y . Los
valores entran de bit en bit comenzando por el
MSB si la señal de control T=1. Si dicha señal
de control T=0 entonces los valores empiezan a
entrar comenzando por los LSB. EL sistema
debe proporcionar una salida Z que informe de
lo siguiente :
SI X>Y
SI Y>X
SI X=Y
EN ESPERA
X, 3 bits
Z
Y, 3 bits
Z=10
Z=01
Z=11
Z=00
Especificar sólo la tabla de estados siguientes y salidas para el sistema completo sabiendo que una
vez que empieza a comparar NO puede cambiar la señal T. Además realizar el diseño completo para el
caso en el cual T=0 siempre.
Nota: utilizando el método del mínimo cambio de bits, obtener para el diseño una codificación óptima.
PROBLEMA 12.
Diséñese un circuito secuencial por Mealy que realice la suma de dos números de n bits. Dicha
suma se realiza bit a bit comenzando por los bits menos significativos y se inicia cuando la señal externa
M=1 . A su vez el circuito debe generar una señal activa por flanco de subida, “D” que active un registro
de desplazamiento donde se van almacenando los datos. El circuito deja de sumar cuando la señal M=0
y entonces proporciona el resultado 0 e inhibe la señal de desplazamiento.
Se debe de indicar el diagrama de flujo, la tabla de estados, el método de codificación, matrices de
excitación y de salida, funciones secuenciales y el esquema del circuito.
x
s
y
D
M
clk
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