Conjunto Residencial Armando Reverón

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316 -M/R
Versión 1
SEMANA 45
1era. Prueba Parcial 1/3
LAPSO 2014-2
UNIVERSIDAD NACIONAL ABIERTA
VICERRECTORADO ACADÉMICO
ÁREA INGENIERÍA
MODELO DE RESPUESTA
ASIGNATURA: MICROPROCESADORES
CÓDIGO: 316
MOMENTO: PRIMERA PRUEBA PARCIAL
VERSIÓN:
01
FECHA DE APLICACIÓN: 08/11/2014
MOD. I, UND. 1, OBJ. 1
Criterio de Dominio 1/1
1. La secuencia y la descripción de la operación de cada instrucción, que permite realizar las
funciones se muestran en la siguiente tabla:
INSTRUCCIÓN
COMENTARIO
ADD
AX, BX
Suma el contenido del registro BX al contenido del registro
acumulador AX
ADD
AX, CX
Suma el contenido del registro CX al contenido del registro
acumulador AX
ADD
AX, DX
Suma el contenido del registro DX al contenido del registro
acumulador AX
ADD
AX, SP
Suma el contenido del registro SP al contenido del registro
acumulador AX
MOV DI, AX
Mueve el contenido de la suma del registro acumulador AX
al registro DI
Criterio de Corrección: Para lograr el objetivo la respuesta del estudiante debe presentar la
misma secuencia de instrucciones señaladas en el modelo. Además, deberá incluir el
comentario para cada una de las instrucciones.
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Especialista:
Olga Rodríguez
Ingeniería de Sistemas
Evaluador: Sandra Sánchez
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316 -M/R
MOD. I, UND. 2, OBJ. 2
Versión 1
SEMANA 45
1era. Prueba Parcial 2/3
LAPSO 2014-2
Criterio de Dominio 1/1
2. Solución:
a) Para la construcción del banco se requiere utilizar dos dispositivos de memoria ROM,
dado que se requiere que la longitud sea de 16 bits y que pueda conectarse
directamente al bus de datos del procesador.
b) En la conexión deberán usarse 13 de las 14 líneas del bus de direcciones, ya que
213 = 8K. Como la palabra del banco debe ser de 16 bits, cada vez que se realice una
operación de lectura se deberá acceder a los dos dispositivos de memoria a la vez,
dado que en un módulo se almacenarán los 8 bits superiores y en el otro los 8 bits de
menor peso. Para activar cada dispositivo se utiliza la señal CS. A continuación se
muestra la representación gráfica de la conexión:
Criterio de Corrección: Para lograr el objetivo el estudiante deberá responder a los
planteamientos a y b de la pregunta, además de justificarlos.
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316 -M/R
Versión 1
SEMANA 45
MOD. I, UND. 3 OBJ. 3
1era. Prueba Parcial 3/3
LAPSO 2014-2
Criterio de Dominio 1/1
3.- Una vez que el ratón activa la línea de entrada 3 del controlador de interrupciones Intel
8259A (punto 1), se producen la siguiente secuencia de acciones en los puntos 2, 3 4 y 5:




Punto 2: El 8259A interrumpe a la UCP a través de la línea INT.
Punto 3: La UCP reconoce la interrupción a través de la línea INTA.
Punto 4: El 8259A da a conocer el número de vector de interrupción (68) y lo
coloca en el bus de datos.
Punto 5: El procesador toma el número de vector de la interrupción y procesa la
interrupción.
Posteriormente se ejecuta el paso 6, en el cual se obtiene la dirección de memoria en
donde está la rutina de atención de la interrupción.
Criterio de corrección: El objetivo será logrado por el estudiante si la respuesta del
estudiante es equivalente a la del modelo y si está debidamente razonada.
FIN DEL MODELO
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